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flash trapとは 意味・読み方・使い方
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「flash trap」の部分一致の例文検索結果
該当件数 : 13件
CHARGE-TRAP TYPE FLASH MEMORY DEVICE AND MANUFACTURING METHOD THEREFOR例文帳に追加
チャージトラップ型フラッシュメモリ装置及びその製造方法 - 特許庁
To provide a flash memory that reduces leakage current from one memory cell to an adjacent memory cell, more particularly a charge trap memory, and a process flow to form the same.例文帳に追加
隣接メモリセルへの漏洩電流を減らすフラッシュメモリ、特にチャージトラップメモリおよびそれを形成するプロセスフローの提供。 - 特許庁
To provide an information processor to prevent data destruction due to hole trap of a flash ROM at low cost and without lowering execution speed.例文帳に追加
安価且つ実行速度の低下を招くことなく、フラッシュROMのホールトラップによるデータ破壊を防止した情報処理装置を提供する。 - 特許庁
The liquid drain unevaporated in the flash tank 4 is sent into a boiler tank 22 via a steam trap 9 to be used as hot water.例文帳に追加
フラッシュタンク4内で蒸発しなかった液状のドレンは、熱水として利用するため、スチームトラップ9を介してボイラタンク22に送り込まれる。 - 特許庁
A logic LSI is integrated into one chip together with a logic FET wherein a high-permittivity insulation film as a gate insulation film and a gate electrode are provided, so as to constitute the charge-trap type flash memory.例文帳に追加
本発明は、ゲート絶縁膜としての高誘電率絶縁膜及びゲート電極を有するロジックFETと共に、1チップ内に混載することによりロジックLSIを半導体基板上に構成する。 - 特許庁
To provide a method of manufacturing semiconductor-device that achieves a charge-trap flash memory capable of executing high-speed processing and having high charge-retention characteristics.例文帳に追加
高速処理が可能で、かつ電荷保持特性の高いチャージトラップ型フラッシュメモリを得ることができる半導体装置の製造方法を提供する。 - 特許庁
To minimize trap phenomenon, in which charges are confined in an insulating layer on an element isolation structure, and prevent interference between bit lines, in the method for manufacturing flash memory device.例文帳に追加
フラッシュメモリ素子の製造方法において、素子分離構造上の誘電体層に電荷が閉じ込められるトラップ現象を最小限に抑えてビット線間の干渉を防ぐようにする。 - 特許庁
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「flash trap」の部分一致の例文検索結果
該当件数 : 13件
To prevent degradation of performance caused by occurrence of trap and defect due to movement of electrons in a tunnel oxide film with respect to an AND type flash memory in which memory cells consisting of nMOS transistors are arranged in (m) rows and (n) columns.例文帳に追加
n型のMOSトランジスタからなるメモリセルがm行n列に配列されているAND型フラッシュメモリにおいて、電子の移動によりトンネル酸化膜にトラップや欠陥が発生して性能が低下することを防止する。 - 特許庁
To provide a charge trap flash memory cell with multi-doped layers in an active region, a memory array using the memory cell and an operating method of the same.例文帳に追加
アクティブ領域に複数層のドーピング層を有する電荷トラップフラッシュメモリセルとこれを利用したメモリアレイ及びその動作方法の提供。 - 特許庁
To provide a method for forming a high-k dielectric layer that may be utilized to form a metal gate structure in TANOS charge trap flash memories.例文帳に追加
TANOS電荷トラップフラッシュメモリにおいて金属ゲート構造を形成するために用いることができる高k誘電体層を形成する方法の提供。 - 特許庁
To provide a method of forming a tunnel insulation film of a flash memory device that can improve leak current property and insulation breakdown voltage property or the like by suppressing boron impregnation by forming a silicon oxinitride film (SiON) through a process of forming the tunnel insulation film including a plasma nitridation process at a temperature higher than 800°C to reduce trap sites.例文帳に追加
800℃以上の高温のプラズマ窒化処理工程を含んでトンネル絶縁膜を形成することにより、トラップサイト(trap site)を減少させ、シリコン酸化窒化膜(SiON)の形成によってホウ素浸透を抑制して漏れ電流および絶縁破壊電圧特性などを改善することが可能なフラッシュメモリ素子のトンネル絶縁膜形成方法の提供。 - 特許庁
In a flash memory having, for example, a single gate type memory cell consisting of a gate electrode provided through a thin electric charge trap layer on a semiconductor substrate, the device is characterized in that after data is written in the memory cell, a short pulse is applied to the memory cell so that one part of electrons is eliminated from the electric charge trap layer.例文帳に追加
半導体基板上の薄い電荷トラップ層を介して設けられたゲート電極からなる例えば単ゲート型メモリセルを有するフラッシュメモリにおいて、前記メモリセルに対してデータ書込み後、前記電荷トラップ層から電子を一部排除するよう前記メモリセルに対して短パルスを加えることを特徴とする不揮発性半導体メモリ。 - 特許庁
To prevent charges accumulated in a charge accumulating area of a trap film of a MONOS-type (metal oxide nitride oxide silicon-type) to migrate, by only simply changing the structure of the MONOS-type flash memory, and to resolve a problem that the read margin of the memory reduces.例文帳に追加
MONOS型フラッシュメモリに関し、MONOS型フラッシュメモリの構造に簡単な改変を加えるのみで、トラップ膜の電荷蓄積領域に蓄積される電荷がマイグレーションすることを抑止し、メモリの読み出しマージン縮小の問題を解消しようとする。 - 特許庁
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