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insulated gate field effect transistorsとは 意味・読み方・使い方
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Weblio専門用語対訳辞書での「insulated gate field effect transistors」の意味 |
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insulated gate field effect transistors
「insulated gate field effect transistors」の部分一致の例文検索結果
該当件数 : 12件
SEMICONDUCTOR DEVICE INCLUDING INSULATED GATE FIELD-EFFECT TRANSISTORS例文帳に追加
絶縁ゲート型電界効果トランジスタを含む半導体装置 - 特許庁
A semiconductor device 70 is provided with a plurality of insulated-gate field-effect transistors on a semiconductor substrate 1.例文帳に追加
半導体装置70には、半導体基板1上に複数の絶縁ゲート型電界効果トランジスタが設けられる。 - 特許庁
To provide a semiconductor integrated circuit, wherein insulated gate field effect transistors with different thresholds are formed in the same well region.例文帳に追加
同一ウェル領域にしきい値の異なる絶縁ゲート電界効果トランジスタが形成された半導体集積回路を提供する。 - 特許庁
An integrated circuit device is constituted by integrating a plurality of insulated gate type field effect transistors.例文帳に追加
本発明は、絶縁ゲート型電界効果トランジスタを複数個集積して成る集積回路装置とする。 - 特許庁
In metal, oxide, and semiconductor field effect transistors as well as an insulated gate bipolar transistor; a location having an interface with a high-concentration impurity layer tends to be subjected to reduction of the withstand voltage of the insulating film.例文帳に追加
金属・酸化物・半導体電界効果トランジスタ、絶縁ゲート型バイポーラトランジスタにおいて、絶縁膜の絶縁耐圧が低下しやすい箇所は高濃度不純物層と界面をもつ箇所である。 - 特許庁
Gates 14G of the insulated gate type field effect transistors and wiring layers 14L facing the gates 14G are composed of NbCN films which turned to superconducting states under cryogenic circumstance.例文帳に追加
絶縁ゲート型電界効果トランジスタのゲート14G とこれに対する配線層14L とを、極低温環境下で超電導状態になるNbCN膜から構成する。 - 特許庁
To provide metal, oxide, and semiconductor field effect transistors, as well as an insulated gate bipolar transistor, which have a structure capable of preventing reduction of the withstand voltage of an insulating film while avoiding change of characteristics of a prior art structure.例文帳に追加
従来構造の特性を変えずに、絶縁膜の絶縁耐圧が低下を防いだ構造をもつ金属・酸化物・半導体電界効果トランジスタ、絶縁ゲート型バイポーラトランジスタを提供すること。 - 特許庁
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「insulated gate field effect transistors」の部分一致の例文検索結果
該当件数 : 12件
To provide an integrated circuit device using insulated gate type field effect transistors where signal transmission delay is remarkably reduced under the actual operation of an element.例文帳に追加
本発明は、素子実働下で信号伝搬遅延を大幅に小さくした絶縁ゲート型電界効果トランジスタを用いた集積回路装置を提供せんとするものである。 - 特許庁
A plurality of insulated gate field-effect transistors, which are formed surrounded by an element isolation insulating layer and provided with a neutral region 4c which is not depleted in a part of a semiconductor layer 4, are formed in the semiconductor layer 4 formed on a substrate 1 via an embedded insulating layer 3.例文帳に追加
基板2上に埋込絶縁層3を介して形成された半導体層4内に、それぞれ素子分離絶縁層により周囲を囲まれ形成され、かつ、半導体層4の一部に空乏化されない中性領域4cを備える複数の絶縁ゲート電界効果トランジスタを有する。 - 特許庁
Semiconductor devices include an insulated trench electrode 11 in a trench 20, for example, trench-gate field effect power transistors and trenched Schottky diodes, a cavity 23 is provided between the bottom 25 of the trench electrode 11 and the bottom 27 of the trench 20 to reduce the dielectric coupling between the trench electrode 11 and the body portion 14 at the bottom 27 of the trench 20.例文帳に追加
トレンチ型電界効果パワートランジスタ及びトレンチ型ショットキダイオードのような、トレンチ20において絶縁トレンチ電極11を含む半導体デバイスにおいて、トレンチ20の底部27において本体部分14とトレンチ電極11との間の誘電結合部を低減させるために、トレンチ20の底部27とトレンチ電極11の底部25との間にキャビティ23がもたらされる。 - 特許庁
The semiconductor integrated circuit includes a well region 13 of second conductivity type composed by connecting first regions 14a, 14b and 14c having a first resistance and second regions 15a and 15b having a second resistance higher than the first resistance, and insulated gate field effect transistors 16 and 17 formed in the first regions 14b and 14c.例文帳に追加
第1抵抗を有する第1領域14a、14b、14cと第1抵抗より高い第2抵抗を有する第2領域15a、15bとが連接してなる第2導電型のウェル領域13と、第1領域14b、14cに形成された絶縁ゲート電界効果トランジスタ16、17と、を具備する。 - 特許庁
In the case of standby, in order that the output ϕ2 of the first function circuit cell 13 may be in a high potential state and the output ϕ3 of the second function circuit cell 14 may be in a low potential state, the first and second insulated gate field-effect transistors M1 and M2 are driven to suppress through current flowing through the other function circuit cell.例文帳に追加
スタンバイ時に、第1機能回路セル13の出力φ2が高電位状態となり、第2機能回路セル14の出力φ3が低電位状態となるように、第1および第2絶縁ゲート電界効果トランジスタM1、M2を駆動し、他方の機能回路セルに流れる貫通電流を抑制する。 - 特許庁
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電界効果トランジスタ
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