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「word-aligned」の部分一致の例文検索結果

該当件数 : 25



例文

double-word aligned発音を聞く 例文帳に追加

倍長語単位で揃えた - 研究社 英和コンピューター用語辞典

The word containing the single word variable must be aligned on a full word boundary.発音を聞く 例文帳に追加

単一の語変数を含む語は全語境界に位置合せされなければならない。 - コンピューター用語辞典

As above, the offset must typically be word-aligned.発音を聞く 例文帳に追加

上と同様に、通常、オフセットはワード境界になければならない。 - JM

VERTICAL DRAM CELL HAVING WORD LINE SELF-ALIGNED WITH STORAGE TRENCH例文帳に追加

記憶トレンチに自己整合したワード線を有する垂直DRAMセル - 特許庁

Typically the offset must be word-aligned, though this might vary by architecture.発音を聞く 例文帳に追加

たいていはオフセットはワード境界になければならないが、アーキテクチャによってはその必要はない。 - JM

The controller is operable to fetch a thirty-two bit word of the received bit-stream, determines whether or not the start code prefix and the start code value are properly aligned within the thirty-two bit word, and determine whether or not the least significant byte of the thirty-two bit word may be part of the start code prefix if not properly aligned within the thirty-two bit word.例文帳に追加

該制御器は受取ったビットストリームのうちの32ビットワードをフェッチし、該32ビットワード内においてスタートコードプレフィックスとスタートコード値が適切に整合されているか否かを決定し、該32ビットワード内において適切に整合されていない場合には、該32ビットワードの最小桁バイトがスタートコードプレフィックスの一部である可能性があるか否かを決定する、べく動作可能である。 - 特許庁

例文

In this case, the address of head data in each kind of word-aligned compression data is successively stored in a pointer arrayal area.例文帳に追加

このとき、各ワードあラインされた圧縮データの先頭データのアドレスをポインタ配列領域に順次格納する。 - 特許庁

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「word-aligned」の部分一致の例文検索結果

該当件数 : 25



例文

To perform the unaligned memory access of a word or a double length word on any byte boundary by the same execution time amount as aligned access without adding so much hardward.例文帳に追加

ハードウェアを余り追加せず整列アクセスと同じ実行時間量でいかなるバイト境界上でも語又は倍長語を非整列メモリ・アクセス可能とする。 - 特許庁

A fixed length code word reads determined available bits and bits associated with a portion of the processor-aligned data, and a variable length code word reads at least some of the available bits.例文帳に追加

固定長コードワードは、決定された利用可能なビットと、プロセッサアライメントされたデータの一部分と関連づけられたビットと読取り、可変長コードワードは、利用可能なビットの少なくとも一部を読み取る。 - 特許庁

The memory cell is defined, at an intersecting point between the bit line and the word line and is provided with a size defined by the widths of the bit line and the word line in a self-aligned process.例文帳に追加

メモリセルは、ビットラインとワードラインとの交差点に画定され、自己整列プロセスにおけるビットライン及びワードラインの幅によって画定された寸法を有する。 - 特許庁

When the current is passed through the word and bit lines (110 and 120), magnetic fields, generated by the word line (110) and the bit line (120) at a coextensive portion, are substantially aligned.例文帳に追加

電流がワードラインおよびビットライン(110,120)に流れると、ワードライン(110)およびビットライン(120)によって同延部分に生じる磁界は、実質的に整列する。 - 特許庁

In a first active region 101, memory gate electrodes 105 are aligned and formed commonly in the word line direction, and impurity-diffused layers 107, to be transistor source regions or drain regions, are aligned and formed commonly in the bit line direction.例文帳に追加

第1の活性領域101においては、ワード線方向に並ぶメモリゲート電極105がワード線方向に共通に形成され、ビット線方向に並ぶメモリトランジスタのソース領域又はドレイン領域となる不純物拡散層107がビット線方向に共通に形成されている。 - 特許庁

A 1-bit self-aligned SONOS cell that improves homogeneity failure between odd and even number SONOS inter-cells stemmed from the differences of oxyniride film lengths caused by misalignment that occurs at the time of the word line etching of the self-aligned 1-bit SONOS cell, and its forming method are provided.例文帳に追加

1ビットSONOSセルのワードラインエッチング時に発生しうるミスアラインによる窒化膜長さの差のために発生する奇数/偶数SONOSセル間の均一性不良が改善できる自己整列型1ビットSONOSセル及びその形成方法である。 - 特許庁

For this purpose, insulating film patterns to form sidewall word lines for gates on a semiconductor substrate are made, word lines for gates on its sidewalls are formed, and a spacer for self-aligned etching is used, when etching of an ONO film is performed.例文帳に追加

このために本発明は半導体基板上に側壁ワードライン形成用の絶縁膜パターンを作ってその側壁にゲート用ワードラインを形成し、ONO膜をエッチングする時に自己整列型エッチング用スペーサを使用する。 - 特許庁

例文

Then, the gate electrode of the transistor of the first cell and the capacitor of the second cell are aligned in the direction of the word line, and the gate electrode of the transistor and the second electrode of the capacitor of the second cell are connected by a common line.例文帳に追加

そして、第1セルのトランジスタのゲート電極と第2セルのキャパシタをワードライン方向に並べ、そのトランジスタのゲート電極と第2セルのキャパシタの第2電極とを共通のラインで結んだ。 - 特許庁

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