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    Le document contient des exercices sur la représentation des nombres en binaire décalé et en complément à deux, la conversion entre ces formats et la représentation en virgule flottante IEEE 754.

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    Université Abou Bekr Bel Kaid – Tlemcen

    Faculté de Technologie Département de Télécommunications


    1 e r Master ST Représentation des données
    TD01 Circuits Programmables FPGA 2017/2018

    Exercice 01 :
    Pour représenter des nombres négatifs on fait appel dans la plus part des cas
    aux code Binaire décalé (Offset Binary) et le code complémént à deux ( Tow’s
    complément).

    1) Le code binaire décalé   : le nombre le plus négatif est codé par 0. les
    suivants, dans l’ordre sont codés en binaire naturel.

    2) Le complément à deux   : c’est zéro qui est codé par 0quand on arrive au bout
    du format on recommence à l’autre extrémité.

    a) Coder par le binaire décalé puis par le complément à deux le groupe des
    chiffres
    {-4, -3, -2, -1, 0, 1, 2, 3}  ?

    b) Que représente le MSB (Most Significant Byte) pour les deux types de codage  ?

    Exercice 02 :

    1) Convertir la suite suivante en représentation complément à deux pour un


    processeur 8bits  :

    16, 32, 64, -16, -32, 64, -1, -125,127.

    2) La suite précédente est décodée dans un processeur 16 bits, afficher les résultats.

    Exercice 03 :

    Convertir la suite de bits suivants, exprimée en virgule flottante IEEE 574.

    a. ‘01000001001100100000000000000000’

    b. ‘11010001101100100000000000000000’

    c. ‘10000001001111010000000000000000’

    Exercice 04 :
    1. Calculer les valeurs réelles, des nombres suivants, en représentation IEEE574  :
    C1700000 H E X  ; 65FE0000 H E X
    2. Convertir les réels suivants en notation IEEE574  :
    76 D E C   ; 231 D E C
    3. Ecrire en IEEE574 le réel 0  ? (écriture binaire puis hexadécimale)
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    Université Abou Bekr Bel Kaid – Tlemcen
    Faculté de Technologie Département de Télécommunications
    1 e r Master ST Représentation des données
    TD01 Circuits Programmables FPGA 2017/2018

    Exercice 05 :
    A l’aide d’une mémoire morte 4bits, réaliser les fonctions suivantes  :
    F0(2,2,57), F1(0,1,5), F2(3,4,5,7), F3(0,1,4).
    Préciser la taille minimale di bus d’adresse et la capacité minimale de la mémoire.
    Exercice 06 :
    S oit l a fi gure si dessous  :

    Cin entrée
    1. Quel est le type du circuit
    2. Quelle est la fonction Logique réalisée

    Exercice 07 :
    Soit la figure si dessous  :

    1. Quel est le type du circuit.


    2. Quelle est la fonction Logique réalisée

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