Chapitre II Principaux composants d’un ordinateur

1. Introduction
Les ordinateurs sont des machines programmables capables d’effectuer un nombre important d’opérations avec
précision en un temps très court. Von Neumann est le premier qui a défini une architecture globale de
l’ordinateur telle que nous l’avons présenté dans le chapitre I. Ce chapitre a pour objectif de détailler les
composants de l’architecture de Von Neumann.

2. Architecture globale de Von Neumann

L’architecture de Von Neumann (cf. figure 1) met en fonctionnement quatre éléments fondamentaux :
l’unité de commande (appelée aussi unité de contrôle), l’unité de traitement, la mémoire centrale (ou mémoire
de travail) et les unités d’échange.
La mémoire centrale stocke deux types d’informations :
– les instructions du programme que la machine devra exécuter ;
– les données sur lesquelles vont opérer les traitements dictés par les instructions.
A ces deux types d’informations correspondent deux unités distinctes : l’unité de contrôle et l’unité de
traitement.
L’unité de contrôle permet :
– d’extraire à partir de la mémoire centrale l’instruction à exécuter ;
– l’analyser (la décoder) et établir les connexions électriques correspondantes ;
– extraire à partir de la mémoire centrale les données sur lesquelles porte l’instruction ;
– déclencher le traitement de ces données dans l’unité de traitement ;
– ranger éventuellement les résultats de calcul dans la mémoire centrale.
L’unité de traitement effectue sur les données qu’elle reçoit les traitements commandés par l’unité de
contrôle.
L’unité de contrôle et l’unité de traitement forment en général un seul ensemble dans un ordinateur. On
appelle cet ensemble unité centrale ou CPU (Central Processing Unit). Quelques fois, on désigne par unité
centrale l’ensemble : unité de contrôle, unité de traitement et la mémoire centrale.

Unité de commande

Unité de traitement Mémoire centrale Unité d’échange

(Entrée/Sortie)
Unité centrale ou CPU

Bus
Figure 1 : Architecture globale d’un ordinateur (Von Neumann)

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2.1. CPU
Le CPU constitue le cœur de l’ordinateur. Il se charge de l’exécution des programmes et de la coordination
entre les différents organes de l’ordinateur. Il est composé de deux parties : la partie opérative qui correspond à
l’unité de traitement, et la partie de commande qui correspond à l’unité de contrôle.
2.1.1. Unité de contrôle
Le rôle de l’unité de contrôle (cf. figure 2) est l’exécution des instructions. Elle est composée essentiellement
de :
- Registre d’Instruction (RI) : utilisé pour contenir l’instruction à exécuter ;
- Registre Compteur Ordinal (CO) noté communément PC (Program Counter) : utilisé pour contenir l’adresse
de la prochaine instruction à exécuter ;
- un séquenceur : circuit logique qui se charge d’analyser le code opération COP de l’instruction (COP est une
partie de l’instruction indiquant le type et la nature du traitement à effectuer) et générer un ensemble de signaux
pour activer le circuit concerné par l’exécution de l’instruction.

Figure 2 : Unité de contrôle

2.1.2. Unité de traitement
L’unité de traitement (cf. figure 3) se charge d’effectuer les traitements dictés par les instructions. Ces
traitements se résument en des opérations arithmétiques (addition, soustraction, multiplication, etc.) et logiques
(comparaison, ET logique, etc.).
Elle est essentiellement composée de :
- Unité Arithmétique et Logique (UAL) : ensemble de circuits logiques permettant de réaliser les
différentes opérations arithmétiques et logiques;
- Registre accumulateur (ACC) : permet de contenir l’opérande de l’instruction en cours d’exécution et le
résultat ;
- Registre indicateur (IND) : constitué d’un ensemble de bits indépendants (les indicateurs ou drapeaux)
positionnés par l’UAL à l’issue de chaque opération pour indiquer l’état du résultat et les conditions dans
lesquelles s’est terminée l’opération : résultat nul, négatif, débordement, retenue… ;

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- Un ensemble de registres généraux servant généralement à contenir les opérandes ainsi que les résultats
intermédiaires.

Figure 3 : Unité de traitement

Pour effectuer les différents calculs, l’unité de traitement dispose de plusieurs registres permettant de
contenir provisoirement les opérandes (données) requis par les calculs. Une fois, les opérandes sont stockés
dans les registres de cette unité, un signal de commande (provenant du bus de commande) précisant l’opération
à effectuer va activer le circuit logique permettant de réaliser l’opération. Par exemple s’il s’agit d’une addition,
c’est le circuit additionneur qui sera activé. Etant donné que cette unité dispose de plusieurs registres généraux,
un dispositif de sélection (DS) permet de sélectionner celui qui est concerné par l’opération pour soit lui affecter
un opérande en provenance de la mémoire centrale ou y accéder pour récupérer un opérande pour le stocker en
mémoire centrale ou bien l’utiliser dans l’UAL pour obtenir un résultat de traitement.
Le registre ACC est également utilisé par les instructions de branchement pour réaliser des ruptures de
séquences au niveau de l’exécution des programmes. Ceci est réalisé grâce à des tests sur le contenu de ce
registre. C’est le registre IND qui indique l’état du registre ACC. Ce registre est relié à l’unité de contrôle qui
s’en sert pour exécuter les instructions de branchement. Certaines lignes de commandes proviennent de l’unité
de contrôle. Ces lignes sont utilisées pour préciser le type d’opération à réaliser (addition, opération logique,
etc.).

2.2. Notion de bus :

Afin de s’échanger les informations, L’ensemble des unités de l’ordinateur sont interconnectés à l’aide
de bus. Un bus est un ensemble de fils permettant de véhiculer les informations entre les différentes
composantes de la machine. Chaque fil véhicule un bit.
On distingue trois types de bus système :
- bus de données : permet de transporter les données et les instructions ;
- bus d’adresses : permet de transporter les adresses mémoires ;

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- bus de commandes : permet de véhiculer les différents signaux de commande générés par l’unité de
contrôle.
Un bus est caractérisé par le volume d'informations transmises simultanément.
Ce volume, exprimé en bits, correspond au nombre de lignes physiques sur lesquelles les données sont envoyées
de manière simultanée.
On parle ainsi de « largeur » pour désigner le nombre de bits qu'un bus peut transmettre simultanément.
La vitesse du bus est définie par sa fréquence (exprimée en Hertz), c'est-à-dire le nombre de paquets de
données envoyés ou reçus par seconde. Le débit maximal du bus (ou taux de transfert maximal), c'est-à-dire la
quantité de données qu'il peut transporter par unité de temps.

Il est égal au produit de sa largeur par sa fréquence ==> Débit = Largeur * Fréquence

2.3. Les registres

Ce sont des éléments de mémoire situés dans le processeur et ils sont accessibles sans passage par le bus.
Ils sont considérés comme étant des variables matérielles qui servent principalement au stockage des opérandes
et des résultats intermédiaires.
Ils possèdent une grande vitesse de Lecture/Ecriture: c’est la mémoire la plus rapide d'un ordinateur.
Les registres sont conçus à partie d’un ensemble de bascules organisés dans un bloc synchrone ayant une
fonction commune.
Ils se trouvent généralement dans des multiples de 8 bits (un octet).
Certains (voire la totalité) des registres du processeur sont rassemblés dans une mémoire interne au processeur
qu’on appelle Banc de registres (Register File RF).
Un banc de registres contient une entrée d'adresse sur laquelle on place une suite de bits qui permet d'identifier
le registre à sélectionner. Cette suite de bits n'est autre que le nom du registre en question.
Les bancs de registre multiports disposent de plusieurs ports d'accès, afin de pouvoir lire ou écrire dans
plusieurs registres à la fois.
Certains registres, tels que le Program Counter PC, le registre d’état, … ne sont pas rassemblés avec les
autres registres et sont souvent intégrés dans des circuits spécialisés ou mis à part des autres registres.

2.4. Mémoire centrale

2.4.1. Quelques définitions

 La latence : Elle caractérise le délai entre l’envoi d’une commande et la réception du résultat. Ce
délai est fonction du temps de réaction et de transfert interne. Il dépend des temps d’accès à une
adresse spécifique et du délai entre la lecture des données à cette adresse et son transfert sur le bus
de données.
 Le temps cycle: Le temps entre deux opérations mémoires successives.
 Le temps de cycle = 1 / fréquence(H).
 Le temps d’accès: Le temps entre l’envoi d’une adresse et l’obtention de la donnée.
 Temps de latence = Temps de cycle + Temps d'accès.

2.4.2. Types de mémoire

La mémoire est un dispositif capable d’acquérir des informations, de les stocker (en binaire) et de les
restituer à la demande. La représentation binaire de l’information fait que cette dernière soit codée suivant
une configuration de bits ou chaque bit représente une information élémentaire de soit « 1 » ou « 0 ».
La figure 4 illustre les différents types de la mémoire :
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Mémoire à semi-conducteurs

Mémoire vive Mémoire morte

permet les opérations de ne permet que des opérations de
lecture et d'écriture "RWM – lecture "ROM Read Only
Read Write Memory-" Memory-"

PROM "Programmable
La RAM "Random Access ROM": mémoire morte
Memory": mémoire vive à programmable par
accès aléatoire. l'utilisateur et de façon
irréversible.
DRAM "Dynamic RAM": Ne retiennent EPROM "Erasable
l'information que pendant un temps limité. PROM": même que la
Il s’agit d’une mémoire dont chaque La mémoire PROM avec possibilité
transistor couplé à un condensateur donne centrale. de l'effacer plusieurs fois
l’information d’un bit ==> en utilisant les rayons
1 information (1 bit) = 1 transistor. ultraviolets.

SRAM "Static RAM": Conservent les EAROM "Electrically

données tant que le circuit est sous La mémoire Alterable ROM": même
tension. cache. principe que la EPROM
1 information (1 bit) = 1 bascule. mais l'effacement est
électrique et sélectif.

Figure 4 : Les différents types de la mémoire

2.4.3. La mémoire centrale :

C’est une mémoire de type DRAM. La figure 5 illustre la composition de la mémoire centrale.
La mémoire centrale est composée de :
- Un ensemble de cases mémoire disposées d’une façon ordonnée composant la mémoire centrale. Chaque case
mémoire est composé à son tour d’un ensemble de cellules chacune permettant de stocker un bit. Le nombre de
bits composant la case définit la longueur ou la taille de la case mémoire.
La capacité ou la taille de la mémoire est le nombre d'emplacements mémoires.
Dans une mémoire de taille N, on a N emplacements mémoires, repérés par un numéro
"0 à N-1" appelé adresse.
⇒ Taille mémoire = Nbre emplacement * Longueur de la case mémoire
Chaque case mémoire est caractérisée par deux informations :

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 Une adresse : valeur entière indiquant la position de la case mémoire. L’adresse est codée sur un certain
nombre de bits. Avec n bits d’adresse, on peut avoir une mémoire de 2n cases mémoires différentes.
 Une valeur ou un contenu : correspond à l’information binaire stockée dans la case à un moment donné
et peut être modifiée par les instructions.
- Registre d’Adresse Mémoire (RAM) : Contient l’adresse de la case à lire ou à écrire ;
- Registre d’Information Mémoire (RIM) : Contient le contenu de la case correspondant à l’adresse indiquée
dans le RAM après un signal de lecture ou l’information à écrire dans la case adressé par le contenu du RAM en
cas d’écriture ;
- Un dispositif de sélection (SD) : il s’agit d’un circuit décodeur qui décode l’adresse indiquée dans le RAM
afin de sélectionner la case mémoire correspondante.

Figure 5 : Mémoire centrale

- Le signal de sélection doit être positionné pour indiquer que la mémoire centrale est choisie.
- Les seules opérations possibles sur la mémoire centrale sont :
 La lecture (appelé aussi opération de chargement ou LOAD) : l’information (donnée ou instruction) se
trouvant dans la case sélectionnée est dupliquée dans le registre RIM. Une fois dans le RIM,
l’information peut être mise sur le bus de données pour qu’elle soit conduite vers une autre unité de
l’ordinateur.
 L’écriture (opération de rangement ou STORE) : Le contenu du registre RIM sera recopié dans la case
mémoire concernée (modification du contenu de la case).
- Il existe deux méthodes de lecture/écriture des informations en mémoire :

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 Le little endian (Ex: Intel) : le LSB de l’information est stocké en premier en mémoire « adresse
inférieure ».
 Le big endian (Ex: Motorola) : le MSB d’une information est stocké en premier en mémoire « adresse
inférieure ».
 Exemple : soit à écrire en mémoire l’information en hexadécimale suivante : 0x 4F56CA90 à l’adresse
00001000

00001100 00001101
00001100 00001100
00001011 4F 00001011 90
00001010 56 00001010 CA
00001001 CA 00001001 56
00001000 90 00001000 4F

Little endian Big endian

2.4.4. La mémoire cache

C’est une mémoire de type SRAM. Elle a pour fonction d’accélérer les communications entre un
microprocesseur et un composant servant à stocker les données (Généralement la mémoire centrale).
Elle permet en partie de palier à l'insuffisance de fourniture des informations par l'unité de stockage que le
processeur peut en traiter.
Lorsque le microprocesseur a besoin d’une donnée, il regarde si elle est disponible dans la mémoire cache,
si ce n’est pas le cas, il va la chercher dans l’unité de stockage et en même temps la dépose dans la mémoire
cache. Ainsi la prochaine fois qu'il aura besoin de cette information, il y accédera directement par la mémoire
cache et donc plus rapidement.

Une mémoire cache est une unité de stockage plus petite mais plus rapide qui s’interpose entre le
microprocesseur et l’unité de stockage. On peut répéter cette opération et ajouter une autre mémoire cache,
même une troisième, etc ... On parle dans ce cas de niveaux de cache.

Cache de niveau 1 (ou cache Level1 ou cache L1) Il est intégré au microprocesseur. Sa taille est
essentiellement fonction de l’architecture du microprocesseur (AMD a toujours privilégié des caches L1 de
grande taille (64 Ko) pour le K6 et 128 Ko pour l’Athlon, tandis qu’Intel privilégie des caches L1 de petite taille
(32 Ko) pour les Pentium II/III). Il est scindé en deux parties de taille égale : L’une stocke les instructions des
programmes, l’autre les données des programmes. Les autres caches ne font pas cette distinction.

Cache de niveau 2 (ou cache L2) Il est intermédiaire entre le cache L1 et la mémoire RAM. Il ne différencie
pas données et programmes. Il est moins rapide que le cache L1, mais sa taille est plus importante de 256 Ko à 2
Mo. C’est un cache externe et a été monté à l'origine sur la carte mère à proximité du processeur. Le cache L2
est maintenant intégré au processeur.

Cache de niveau 3 (ou cache L3) Sa taille varie de 1 Mo à 8 Mo (valeur généralement constatée mais il n’y a
pas de limitation technique).
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2.4.5. Hiérarchie de mémoires

Une mémoire est un dispositif capable d'enregistrer, de conserver et de restituer des informations.
On distingue 5 types de mémoire :

Registre coût

Cache

Mémoire centrale

Mémoire d’appui

Mémoire permanente : disque dur

Capacité et
temps d’accès Mémoire optique Mémoire magnétique

Quand on s'éloigne du processeur vers les mémoires auxiliaires, le temps d'accès augmente, la capacité
augmente et le coût par bit diminue

2.5. Unités d’échange

Lorsque l’unité de contrôle rencontre une instruction d’échange d’informations avec l’extérieur
(instruction d’entrée/sortie), elle commande les unités d’échange.
Il existe deux types d’unités d’échange :
- Les mémoires auxiliaires : appelées mémoires secondaires par opposition à la mémoire centrale et
dont les capacités de stockage sont de loin plus importantes que celle de la mémoire centrale (exemple : disque
dur, lecteur DVD, disque amovible, etc.). Elles sont utilisées pour stocker les informations de manière
permanente.
- Les unités de communication : ont pour rôle de communiquer l’information soit depuis l’ordinateur
vers l’utilisateur ou l’inverse (exemples : clavier, souris, écran, imprimante, etc.).