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    Diseño Digital

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    LUIS BARRERA
    Este documento describe una práctica de laboratorio sobre circuitos aritméticos y decodificadores digitales. La práctica incluyó implementar un circuito lógico para calcular la función F(x)=x^2+4 y diseñar un decodificador BCD a 7 segmentos de dos formas: usando compuertas lógicas y un decodificador 4 a 16. Los resultados mostraron que ambos métodos produjeron los mismos comportamientos durante la simulación.

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    LUIS BARRERA
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    Este documento describe una práctica de laboratorio sobre circuitos aritméticos y decodificadores digitales. La práctica incluyó implementar un circuito lógico para calcular la función F(x)=x^2+4 y diseñar un decodificador BCD a 7 segmentos de dos formas: usando compuertas lógicas y un decodificador 4 a 16. Los resultados mostraron que ambos métodos produjeron los mismos comportamientos durante la simulación.

    Descripción original:

    Decodificador BCD a 7 segmentos FI UNAM

    Título original

    Diseño digital

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    Este documento describe una práctica de laboratorio sobre circuitos aritméticos y decodificadores digitales. La práctica incluyó implementar un circuito lógico para calcular la función F(x)=x^2+4 y diseñar un decodificador BCD a 7 segmentos de dos formas: usando compuertas lógicas y un decodificador 4 a 16. Los resultados mostraron que ambos métodos produjeron los mismos comportamientos durante la simulación.

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    Este documento describe una práctica de laboratorio sobre circuitos aritméticos y decodificadores digitales. La práctica incluyó implementar un circuito lógico para calcular la función F(x)=x^2+4 y diseñar un decodificador BCD a 7 segmentos de dos formas: usando compuertas lógicas y un decodificador 4 a 16. Los resultados mostraron que ambos métodos produjeron los mismos comportamientos durante la simulación.

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    UNIVERSIDAD NACIONAL AUTÓNOMA DE MÉXICO

    FACULTAD DE INGENIERÍA

    DEPARTAMENTO DE INGENIERÍA ELÉCTRICA

    LABORATORIO DE DISEÑO DIGITAL


    ING. OMAR EDSIEL ABREGO BLANCAS

    Práctica 3. Circuitos aritméticos y decodificadores..

    Ramirez Barrera Luis Ángel


    Grupo 5

    Fecha de Entrega: 19 de Marzo de 2020


    1. Objetivo
    Analizar, diseñar simular e implementar arquitecturas aritméticas y decodificadores di-
    gitales..

    2. Material
    Tarjeta de desarrollo CPLD C-M240
    Computadora con software Quartus II

    3. Actividad de investigación previa

    Sesión 1.
    Dada la función F (x) = x2 + 4 realizar un circuito lógico que la resuelva en un intervalo de

    x[0,7] donde xN .

    Sesión 2.
    Diseñar un decodificador de BCD a 7 segmentos ánodo común por los siguientes métodos:

    1
    *Por el método de mapas de Karnaugh con compuertas.

    *Usando un decodificadores 4 a 16 (74LS154).

    2
    4. Desarrollo
    Sesión 1.

    1. Implementar la función algébraica en Quartus conectando las entradas a botones de la


    tarjeta y las salidas a los leds.

    Sesión 2.

    1. Implementar los decodificadores en Quartus conectando las entradas a botones de la


    tarjeta y la salida al display de 7 segmentos.

    5. Resultados y Observaciones
    Se obtuvo el siguiente diagrama, representando las compuertas lógicas para el compor-
    tamiento que se necesita para obtener los valores de F(x).

    3
    Figura 1: Representación de la función F(x) utilizando compuertas lógicas

    Al implementar este código a la tarjeta se obtuvieron los comportamientos semejantes a


    la tabla de verdad obtenida en el trabajo previo.
    A continuación, se muestra el código que designa las funciones obtenidas mediante el
    análisis desarrollado en el trabajo previo para el circuito lógico utilizado en el decodificador
    BCD a 7 segmentos, utilizando compuertas lógicas, así como su simulación verificando los
    valores obtenidos en su tabla de verdad.

    Figura 2: Circuito mediante compuertas lógicas para la representación de un decodificador


    BCD a 7 segmentos

    4
    Figura 3: Simulación de Circuito lógico utilizando compuertas

    En esta parte se muestra la representación del decodificador de forma gráfica, se eligieron


    los minterminos para cada uno de los 7 leds de los displays.

    Figura 4: Circuito lógico utilizando decodificador

    Figura 5: Simulación de Circuito utilizando un decodificador

    Podemos observar que para los dos métodos implementados se obtuvieron los mismos
    comportamientos durante cada simulación, donde se trabajaron de manera distinta las en-
    tradas para cada parte.
    Es sencillo poder observar un error que se pueda tener, analizando algún comportamiento
    erróneo en cada segmento de los leds y verificar mediante las tablas de verdad y los mapas
    de Karnaugh los valores obtenidos.

    5
    6. Conclusiones
    En esta práctica se implementaron circuitos lógicos a partir de una función algebraica,
    y esto nos ayudó para fortalecer nuestros conocimientos en Quartus II. Para la ejecución de
    esto fue necesario que se definieran 5 salidas, una por cada bit, e igualmente, fue necesario
    realizar reducciones de estas funciones para su fácil uso. Hacer las conexiones necesarias para
    las cinco funciones no fue de gran dificultad.
    Para la segunda sesión, se implementó la representación de un decodificador BCD a 7
    segmentos de dos formas distintas. Para la primera parte, se representaron las funciones
    lógicas obtenidas mediante lenguaje VHDL
    En la segunda parte, se utilizó la implementación con un decodificador donde se notó
    una gran diferencia, ya que resultó más fácil y rápido , ya que solo bastaba con aterrizar los
    valores para los cuales cada una de las funciones tenía un 0 a una compuerta AND para cada
    uno de los leds (ya que tanto botones como LEDs se encuentran en lógica negada). Gracias a
    la simulación que nos permite hacer Quartus II pudimos comprobar que nuestras funciones
    eran las correctas sin necesidad de tener la tarjeta programable. Por lo que podemos ver que
    al utilizar este decodificador (74LS154) integra las operaciones y compuertas necesarias.

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