Corrigé BTS SE 2009
Corrigé BTS SE 2009
Corrigé BTS SE 2009
Q7.
1 TCON = TCON & 0b11011111 ; // remise à zéro du drapeau d’interruption TF0
2 if ( (P1 & 0b00010000) == 0x00) ; // test de l’état logique de P1.4 (448Hz)
3 {
4 P1 = P1 | 0b00010000 ; // mettre à 1 la patte P1.4 (448Hz)
5 }
6 else
7 {
8 P1 = P1 & 0b11101111 ; // mettre à 0 la patte P1.4 (448Hz)
9 }
10 rti; //retour du sous programme
Q8.
HT0
t
TL0 190 191 192 193 253 254 255 190 191 253 254 255 190 1
t
TF0
t
448HZ
t
0 0 0 1
20k
22,1k 10nF
2,3V
connecteur
HEF4051B ICM U18
14 13
100M R0
0,0mV -
100M
100M
10k
-9,3mV
+
23nA VCM
U17A
-3,1mV I0 -9,3mV HEF4052
câble 46nA - VLAB
LA 34k 100k LAD 301k
+
ILA 220pF 68pF 68pF
U14D RAB 20k 20k
LAB
-3,1mV 0,0mV
23nA
k
20
20
RA - VRAB
k
34k 100k RAD 301k
+
IRA 220pF 68pF
0,0mV
68pF
U14B
IICM IIICM
k
20
20
k
0,0mV
-3,1mV états
23nA LL - VLLB LLB logiques
34k 100k LLD 301k
+
ILL 220pF 68pF 68pF
U14C -
0,0mV 20k
+
LA_FAULT 0
10nF
U23A
20k
-
RA_FAULT
0
+
+7V 10nF
U23C
1,5k
20k
-
LL_FAULT 0
+
20k
k
10nF
1,5
1,5
VREF
1N4148
100nF
électrodes
Q14. Étant donné que la différence de potentiel VRAD est égale à 2,3V (IRA = OA), alors en sortie de
U14B VRAB est égale 2,3V.
VRAB - VLLB
VIICM = ⇒ VLLB = VRAB - 2 ⋅ VIICM
2
AN : VLLB = -2,3 - 2 * 0 = -2,3V
Q15. voir schéma page suivante.
Q16. voir schéma page suivante.
Q17. Une sortie au niveau haut indique un défaut sur l’électrode correspondante.
20k
22,1k 10nF
2,3V
connecteur
HEF4051B ICM U18
14 60 13
100M R0
0,0mV -
100M
100M
-2,3V
10k
+
46nA VCM
U17A
-2,3V I0 -2,3V HEF4052
câble 46nA - VLAB
LA 34k 100k LAD 301k FS17
+
ILA 220pF 68pF 68pF
U14D RAB 20k 20k
LAB
2,3V 2,3V
OnA
k
20
VRAB FS15
20
RA -
k
34k 100k RAD 301k
+
IRA 220pF 68pF
2,3V
68pF
U14B
IICM IIICM
k
20
20
k
-2,3V -2,3V états
46nA LL - VLLB LLB logiques
34k 100k LLD 301k
+
ILL 220pF 68pF
-2,3V
68pF
U14C 20k
-
+
LA_FAULT 0
10nF
U23A
20k
-
RA_FAULT 1
+
+7V 10nF
U23C
1,5k
-
20k LL_FAULT 0
+
20k
k
10nF
1,5
1,5
V REF
100nF
électrodes
G 2 (f) dB
G 3 (f) dB
A (f )
580
410
f = fe/2
Q24.
VMUXOUT
0V t
VTRIANGLE
-4V
TH
VPWM +5V
0V
Q31.
Minimum Maximum
N 0 4096
Rang du bit 15 14 13 12 11 10 9 8 7 6 5 4 3 2 1 0
Valeur binaire 1 0 1 0 0 0 1 1 0 1 1 0 1 0 0 0
MOV AX,0xA368
OUT 0x300,AX
instruction instruction
MOV AX,0xA368 OUT 0x300,AX
CLKOUT
ALE
/PCS6
/WR
/WR6
N XXX
A36
N
Q37. VHLO = 15,8 ⋅ - 8,1 avec N = A36(hex) = 2614( dec )
4096
2614
AN : VHLO = 15,8 ⋅ - 8,1 = 1,98V
4096
Partie F: Transfert des données d'ECG au moniteur
Q38. voir ci-dessous
CH1
CH1 : 2V/div
CH2 : 2V/div
MATH : 1V/div
0V CH1, CH2
TIME : 100ns
+0,2v
0V MATH -0,2v
SDLC_CLK
Q45.
Nom du signal de
Émetteur Récepteur
sélection du mode
RECV_ENAB 0 1
Q46.
RS232 RS485
Liaison asymétrique x
Liaison symétrique (meilleure immunité au bruit) x
Distance liaison < 50m x
Distance liaison < 1km x
Débits < 20 kbauds x
Débits < 10 Mbauds x
Q47.
SDLC_CLK
SDLC_DATA
Q48. et Q49.
SDLC_DATA 1 1 1 1 1 0 1 1 1 1 1 0 1 0 0 1 0 1 1 1 0 0 1 0 1 1 1 1 1 0 1 0 0 1 1
noms des champs adresse destinataire commande | FCS